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最新Core 2微体系架构的Merom处理器，除了引入备受关注的英特尔EM64T运算技术，在架构设计上，更有5大创新设计，如基于4-wide和14级流水线设计，类似Pentium M的micro-ops fusion技术允许将相类似的编码指令“融合”并一同送往流水线，更高级的macro fusion技术则允许x86指令在编码阶段之前进行“融合”并当作单独一条指令送往流水线。还有SSE指令(包括SSE1/SSE2/SSE3)也从由64位升级到128位。 下面就来具体的看一下Merom处理器到底有哪些引以自豪之处。
Intel宽位动态执行（Intel Wide Dynamic Execution）
通过英特尔宽区动态执行技术，使多核处理器中的每个执行内核更加宽阔。每个内核均拥有4组解码器，可以同时获取、分配、执行和返回4条完整的指令。此外还加入宏指令集融合(Macro-Fusion)技术，可以让处理器在解码的同时，将同类的指令融合为单一的指令，减少处理的指令总数，让处理器在更短的时间内，以更低的功率处理更多的指令。
更多的指令解码逻辑单元、更大的乱序指令缓冲空间、更多的保留站入口、更多的指令调度端口、更多的执行硬件、更多的内存缓冲空间等等，这些强化流水线个部分的设计，Merom处理器的微架构比Yonah处理器的微架构更宽、更多硬件资源，性能也大大提高。
Intel智能功率能力（Intel Intelligent Power Capability）
独特的智能功率控制设计，让Merom处理器可以在运行中关闭用不到的特定逻辑处理单元，在降低功耗和发热的同时保证不影响性能，同样Merom处理器中的总线模块在不需要使用时也可以转换为低功耗状态。
此外，在制程技术方面做出优化，采用了先进的65nm Strained Silicon技术、加入Low-K Dielectric物质及增加金属层，相比上代90nm制程减少漏电情况达1000倍。而且通过先进的功率门控技术，来充分利用该微架构的超精细逻辑控制，降低处理器的功耗及发热。
Intel高级智能高速缓存（Intel Advanced Smart Cache）
所谓高级智能高速缓存，Core微架构的缓存结构仍旧延续了Yonah的共享式二级缓存设计。独立式的二级缓存弊端在于，每当一个内核运算改变自己二级缓存的数据时，必须通过FSB和另外一个二级缓存交换变化数据，始终保持一致性，这也大大增加了FSB的流量负担。而共享式二级缓存不同，数据仅需存储在每个内核均可访问的同一个地方，能更加充分利用二级缓存资源。
之所以称为智能，是因为每个核心都可以动态支配100%的全部共享二级缓存，加强了多核心架构效率，大幅增加了缓存的命中率，也可关闭部分缓存降低功耗。这样可以降低缓存的命中失误，减少数据延迟，改进处理器效率，增加绝对性能和每瓦特性能。
Intel智能内存访问（Intel Smart Memory Access）
传统的乱序执行处理器都存在这样的一个准则，在指令修改某个内存地址内容前必须确定之前指令的对该地址内容的读取都完全执行了，这是乱序执行处理器重新对指令排序必需要遵从的一个重要准则。而Core微架构能够对内存读取顺序做出分析，智能、预测性的装载下一条指令所需要的数据，从而大幅提高了执行程序的效率。
Intel高级数字媒体增强（Intel Advanced Digital Media Boost）
在新的Core构架上，英特尔提供了单周期延迟的128-bit 矢量操作能力。Intel通过将浮点和矢量内部传输总线提升到128bit位宽彻底解决了这个问题，另外这一设计的改变也意味着每一条128bitSSE指令之需要产生一条微操作指令，这样新的设计不但消除了执行矢量操作过多延迟，更少的微指令产生量也等同于提高了译码、分派、调度整个内核前端的等效带宽。无论是输入还是输出，其位宽都比它的前辈们有了成倍的提高，以用来适应每周期的128 bit数据传输。简单的说，拥有128bit的SIMD执行能力，一个时钟周期就可以完成一条指令，效率提升明显。
上面就是Core微架构引以为豪的5大创新设计。
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